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전자회로2- 증가형 nMOSFET증폭회로 해석

*용*
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최초 등록일
2011.06.14
최종 저작일
2009.05
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소개글

증가형 nMOSFET의 어려운 공통단자증폭단에 대한 모든것!! 공통 소스,공통드레인,공통게이트 등가회로를 이용하여 보다 알아보기쉽고 이해하기 쉽게!!

목차

없음

본문내용

◆ 공통 소스 증폭기
입력 저항 : 매우 크다,
출력 저항 :
전압 이득 :
입력 전류 : 0
RG : GATE는 0[V]의 직류전압에 연결
RD : 직류 Drain 전압은 Drain에서 요구 되는 신호 swing을 허용,
트랜지스터가 항상 포화 영역 동작을 하도록 한다.
또,
◆ 공통 게이트 증폭기
입력 저항 : 매우 작고,
출력 저항 :
전압 이득 : 공통 소스와 같다. 단 동상
전류 이득 : ‘거의 1`,
를 무시하면,
만약, 이면,
◆ 공통 드레인 증폭기 (소스 플라워)
입력 저항 : 매우 크고
출력 저항 : 매우 작다
전압 이득 : ‘1’ 보다 작지만 거의 ‘1‘
입력 전류 : 0
그림 (d)에서
단,
그림 (b)에서 일 경우,
출력(저항)개방 전압이득, 테브난의 등가전압
`1`보다 작지만 이므로 거의 ‘1’과 같다.
이 증폭회로의 전압이득을 쉽게 구하기 위해 FET의 T등가모델을 이용한다. 그래서,
그림 (c)를 그림 (e)와 같이 고쳐 그리면
그림 (g)에서 테브난 등가회로를 구하면
일 때,
단, 그림 (f)의 등가회로와 같아진다.
◆ Source follower(sedra p.391)
직류전압원은 접지, 직류전류원은 개방

참고 자료

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