논리회로 실험 가산기와 감산기 만점 리포트 입니다.
- 최초 등록일
- 2009.03.26
- 최종 저작일
- 2009.03
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소개글
반가산기를
회로구성
전가산기
회로구성
전가산기 Truth table & 측정값
Parallel adder의 특징
2bit parallel adder Truth table & 측정값
반감산기
회로구성
반감산기 TRUTH TABLE & 측정값 & 카르노맵
전감산기
회로구성
실험감상
목차
실험 3 .가산기와 감산기
실험 1. 예비보고서에서 구상한 반가산기를 구성하고 그 결과를 확인하라.
(2) 반가산기를 이용하여 전가산기를 구성하고 그 결과를 확인하라.
(3) 2-bit serial adder와 2-bit parallel adder를 구성한 뒤 각각의 입력에 대한 출력을 측정하고 결과 값을 확인하라.
(4) 7486 .7400을 이용하여 반감산기를 구성하라.
(5) 예비보보서 문제 5에서 구한 전감산기를 구성하여 동작 결과를 확인하라.
본문내용
실험 1. 예비보고서에서 구상한 반가산기를 구성하고 그 결과를 확인하라.
◎ 반가산기
반가산기(half adder)는 이진수의 한자리수를 연산하고, 자리올림수는 자리올림수 출력( carry out)에 의하여 출력한다. AND, OR, NOT의 세가지 종류의 논리회로만으로 구성할 수 있다.
- 반가산기는 하위 자리에서의 캐리가 없지만, 전가산기는 하위자리에서 캐리를 받아서 셈한다.
- 반가산기는 2진수를 더할 때 최하위 자리의 덧셈을 할 때 사용하고, 그 이후부터는 전가 산기를 사용한다.
- 반가산기는 2개의 입력과 2개의 출력을 필요로 한다.
①회로구성
XOR GATE(7486)와 AND GATE(7408) IC를 이용하여 반가산기를 구성하였다. Date Sheet를 참고하여, IC를 구성하였고 GND와 Vcc=5V 를 설정하여 주었다.
반가산기의 Truth Table값과 출력 값이 정확하게 일치 하였다. 반가산기를 통하여 C (자리올림)과 S(두2진수의 합)을 표현해 줄 수 있었다. 실험.1 을 통하여 반가산기의 특징을 알아 볼수 있었다.
(2) 반가산기를 이용하여 전가산기를 구성하고 그 결과를 확인하라.
◎ 전가산기
전가산기 (full adder)는 이진수의 한자리수을 연산하고, 하위의 자리올림수 입력을 포함하여 출력한다. 하위의 자리올림수 출력을 상위의 자리올림수 입력에 연결함으로써 임의의 자리수의 이진수 덧셈이 가능해 진다. 하나의 전가산기는 두개의 반가산기와 하나의 OR로 구성된다. 입력이 3개 존재해서 (입력 A, 입력 B, 자리올림수 입력) 모두 대등하게 동작한다. 하지만 회로상 에서 3개 입력이 대칭되어 있다고 할 수 없다.
참고 자료
없음