가산기와 감산기 회로 레포트

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가산기와 감산기 회로 레포트입니다.
전자공학과 실험레포트

본문내용

1. 실험목적
① 가산기 회로 설계 및 실험
② 감산기 회로 설계 및 실험
③ BCD 가산기 회로 설계 및 실험

2. 배경이론
- 가산기
① 반가산기 : 2개의 2진수 A와 B를 가산하여 합의 출력 S(sum)과 자리올림수 C(carry)의 출력을 얻는 논리 회로
② 전가산기 : 2개의 2진수 An과 Bn을 가산하고 전에 자리올림수(Cn-1)와 합하여 합(Sn)과 자리올림수(Cn)를 출력하여 얻는 논리 회로
- 감산기
① 반감산기 : 2개의 2진수 A와 B를 감산하여 차의 출력 D(difference)와 자리빌림수 b(borrow)의 출력을 얻는 논리 회로
② 전감산기 : 2개의 2진수 An과 Bn을 감산하고 전에 자리빌림수(bn-1)를 이용해 차(Dn)와 자리빌림수(bn)를 출력하여 얻는 논리 회로

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없음

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