"전전설1" 검색결과 141-160 / 18,642건

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  서울시립대학교 전전설2 5주차 결과레포트(코딩 성공적, A+, 10점 만점 11점)

  X 1 0 0 0 1 1 1 0 0 1 X X 1 0 1 0 X X 1 0 1 1 X X 1 1 0 0 X X 1 1 0 1 X X 1 1 1 0 X X 1 1 1 1 X X - ... 1] Y[0] 0 0 0 0 X X 0 0 0 1 0 0 0 0 1 0 0 1 0 0 1 1 X X 0 1 0 0 1 0 0 1 0 1 X X 0 1 1 0 X X 0 1 1 1 X ... 입력 A[1:0] : Bus SW1, 2 입력 B[1:0] : Bus SW7, 8 입력 S (selector) : Button SW1 출력 Q[1:0] : LED1, 2 - case

  리포트 | 28페이지 | 2,000원 | 등록일 2020.07.22 | 수정일 2020.09.20

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  [검증된 코드 & 복사가능, 학점A+] 전전설2 8.Peripherals - 예비+결과+성적인증 (서울시립대)

  오차율은 모두 0.5% 미만으로 일반적인 실험 대비 매우 정확한 값에 속하지만 Piezoelectric speaker에 의한 전자적인 출력이므로 우발오차가 개입하기 어렵다는 점을 고려하면 정밀하지 못한 결과라고 볼 수도 있다.이에 대하여 ①주변 소음에 의한 random..

  리포트 | 29페이지 | 3,500원 | 등록일 2021.07.10 | 수정일 2021.11.10

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  [검증된 코드 & 복사가능, 학점A+] 전전설2 2.Schematics - 예비+결과+성적인증 (서울시립대)

  HDL을 이용한 설계를 익힐 준비를 마친다.배경 이론 및 사전 조사 실험 전에 조사한 답과 다른 것을 우선 순위로 작성하였다.[3]How many programmable logic ... = 16-to-1 MUX ×1=60 ×1 =60 NANDs∴ SLICE = 4-input LUT ×2=60 ×2 =120 NANDs∴ CLB = SLICE ×4=120×4=480 ... Note)이때, 실험에서 사용하는 XC3S200 FPGA의 구성은 다음과 같다.∴ 16-to-1 MUX = 2-to-1 MUX ×15=4×15 =60 NANDs∴ 4-input LUT

  리포트 | 14페이지 | 3,500원 | 등록일 2021.07.10 | 수정일 2021.07.13

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  서울시립대 전자전기컴퓨터공학부 반도체소자 기말 족보 2022

  시험자료 | 1페이지 | 9,900원 | 등록일 2023.03.07

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  몇 개의 전통 건축어휘의 어원과 표기

  한국건축역사학회 오창명, 천득염

  논문 | 10페이지 | 4,000원 | 등록일 2023.04.05 | 수정일 2023.04.06

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  겨울왕국 vs 센과 치히로의 행방불명 / 디즈니 vs 지브리 비교대조 레포트

  후속작의 제작을 통해 해당 작품의 전 세계적인 인기를 알 수 있다. 1-1(2)센과 치히로의 행방불명 -일본 디즈니 스튜디오에서 제작된 2001년작 2d애니메이션 -아시아 애니메이션 ... 화산활동이 자주 일어나는 국가: 온천사업이 발달해 이를 바탕으로 한 의식주와 상업시설이 작품의 배경이 됨 2-2(2) 해당 지역의 신화 및 전설 반영 -각 모티브가 되는 나라의 토착 ... 1.서론 1-1영화 설명 1-1(1)겨울왕국 -미국 월트디즈니 애니메이션 스튜디오에서 제작된 2013년작 3d애니메이션 -아카데미 시상식 장편 애니메이션 등의 수상이력, 외 장,단편

  리포트 | 3페이지 | 1,000원 | 등록일 2021.01.14

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  설화의 세 가지 층위(신화, 전설, 민담)를 구분하고, <단군신화>를 이와 연결해서 서술하시오.

  1.설화의 세 가지 층위(신화, 전설, 민담)를 구분하고, 를 이와 연결해서 서술하시오. -설화는 일반적으로 신화, 전설, 민담의 세 가지로 구분된다. ... 전설은 전승태도는 사실적인 진실성이고 믿을 만한 이야기이다. ... 허생전?

  리포트 | 3페이지 | 1,000원 | 등록일 2020.01.08

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  시립대 전전설2 Velilog 결과리포트 3주차

  참고문헌 -전전설 교안 -http://cms.kut.ac.kr/user/yjjang/htm_lect/dsys11/M01_VerilogHDL01.pdf -Xilinx ISE 사용법 by ... 시뮬레이션 결과와 실험 결과의 비교 1) 1bit Full Adder ?Gate Primitive Modeling 2) 1bit Full Adder ? ... 시뮬레이션 결과와 실험 결과의 비교 1) 1bit Full Adder ?

  리포트 | 14페이지 | 2,000원 | 등록일 2021.12.11

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  [코드 복사가능, 학점A+] 전전설2 10.Term Project - 예비+결과+발표자료+성적인증 (서울시립대)

  그 결과, line1 & line2를 출력하는 데에 할당된 시간을 늘리고 clk 1Hz에 연결된 것을 clk 1kHz로 변경함으로써 문제를 해결하였다. ... 실험 목적1. Design a digital clock displayed on LCD in Verilog HDL.2. ... Improve your design skills by implementing various additional features on it.실험 목표Obligatory1.

  리포트 | 8페이지 | 3,500원 | 등록일 2021.07.10 | 수정일 2021.11.09

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  전자책의 발전과정 및 활용현황

  본 보고서에서는 전자출판 부문에 나타난 변화를 중심으로 살펴보도록 하겠다. 1.

  리포트 | 6페이지 | 3,000원 | 등록일 2022.10.12 | 수정일 2022.11.01

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  구비문학 자료

  1. 지하국대적퇴치설화 변이 1)거타지 설화(삼국유사) 2)최치원 전설 3)김원전 2. ... 장자못 전설 1)모티프 2)소돔과 고모리 3)징벌의 깊이 4)내용의 주제 5)소설화 7. 동물설화 1)호랑이 설화 2)토끼 설화 3)두꺼비 설화 8. ... 아기장수 설화 1)아기장수 설화에 대한 학자들의 생각 2)우투리 전설 3)아기장수 설화 영향 3. 서사무가 1)초공본풀이 2)이공본풀이 3)삼공본풀이 4)바리데기 4.

  리포트 | 31페이지 | 2,000원 | 등록일 2021.05.14

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  (완전 세세한 정리, 끝판왕) 시립대 전전설2 5주차 Lab05 예비 레포트 Combinational Logic 2, 전자전기컴퓨터설계실험2,

  Y=D2+D3 X=D2+D3 D1 D3 0 1 0 0 1 1 1 0 D1 D3 0 1 0 0 1 1 1 0 Decoder 디코더는 해독기로 2진을 10진으로 바꾸는 역할을 한다. ... S2 S1 00 01 11 10 0 0 0 1 S2 S1 00 01 11 10 0 0 1 0 C=s1s2’ D=s1s2 S2 S1 00 01 11 10 0 1 0 0 S2 S1 00 ... Mux의 Karnaugh Map을 이용한 최적화하면 다음과 같다 Y=S’*D0 + S*D1 D1D0 s 00 01 11 10 0 0 1 1 0 1 0 0 1 1 Demux demux는

  리포트 | 19페이지 | 2,000원 | 등록일 2020.07.27 | 수정일 2020.09.24

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  서울시립대학교 통신공학실습 4주차 예비레포트

  1. Introduction (실험에 대한 소개) 가.

  리포트 | 5페이지 | 2,000원 | 등록일 2019.07.29 | 수정일 2019.08.10

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  서울시립대학교 통신공학실습 6주차 결과레포트

  하지만 BJT에서는 BJT 특성인 증폭이 RLC IF를 설계하여 전에 실험한 동일한 캐리어 주파수와 메시지 주파수를 인가를 하여도 오히려 더 높은 amplitude의 값과 원하는 파형을 ... 다시 파워서플라이와 회로의 INPUT 저항들의 값을 조절하여 INPUT에는 1K옴의 저항을 연결해주고 입력 또한 PSPICE에서 먼저 5V->1V까지 바꿔가면서 ACTIVE 영역이 ... 통신실습 Result Report 6주차 : 믹서 회로 설계 및 제작Ⅱ 1. Introduction (실험에 대한 소개) 가.

  리포트 | 7페이지 | 2,000원 | 등록일 2019.07.29

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  서울시립대학교 통신공학실습 1주차 예비레포트

  신호를 불연속적인 디지털 신호로 바꾸어 전송함에 있어 그 파형을 모두 전송할 필요는 없으며 아날로그 신호의 본래의 특성을 잃어버리지 않는 범위에서 필요한 정보만을 효율적으로 추출하여 전송해야 ... 첫 번째는 N=1이고 f0=1일 때 cos(2πt), 두 번째 N=2이고 f0=1일 때 cos(4πt), 세 번째 f0=1일 때 cos(6πt) 총 3개의 파형을 얻을 수 있다. ... 통신공학실습 Preliminary Report 1주차 : Simulink MATLAB 실습Ⅰ 1. Introduction (실험에 대한 소개) 가.

  리포트 | 6페이지 | 2,000원 | 등록일 2019.07.29 | 수정일 2019.08.10

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  서울시립대학교 통신공학실습 6주차 예비레포트

  통신공학실습 Preliminary Report 6주차 : 믹서 회로 설계 및 제작Ⅱ 1. Introduction (실험에 대한 소개) 가. ... BJT 동작 영역 및 Bias 역할 BJT는 동작에 따라 크게 세 가지 중요한 영역으로 구분 짓는다. (1) Cutoff 영역 (V_BE < 0.7V) Base (B)와 Emitter

  리포트 | 6페이지 | 2,000원 | 등록일 2019.07.29 | 수정일 2019.08.10

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  서울시립대학교 통신공학실습 8주차 결과레포트

  하지만 좋은 파형을 얻는 대신에 낮은 발진주파수 얻는 tradeoff가 생긴다는 것을 감안을 해야했다. 5.5kHz의 발진주파수를 얻은 발진기로 input을 넣어 2~3주 전에 실험하였던 ... R1 과 Rf에 의해 이득 결정 발진 주파수는 L1,C1,C2에 의해서 결정 된다. ... 예비레포트에서 Simulation 조건 C1 = 0.2u C2 = 20n R1 = 1k R2 = 1.5k L = 10m의 파라미터로 설정을 하였다.

  리포트 | 10페이지 | 2,000원 | 등록일 2019.07.29 | 수정일 2019.08.10

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  서울시립대학교 통신공학실습 11주차 예비레포트 파이널

  모든 게인 제어는 신호 검출 전에 이루어지지만 신호 검출 후 게인 제어 단계를 추가하여 게인 제어를 향상시킬 수도있다. ... 입력을 가하기 전 오실로스코프 트리거를 통해 신호를 기다린다. 4. 스위치 on 시키고 RC회로에 스탭을 입력 한다. 5. ... 만약 20.1v가 표시 되면 함수 발생기에서 10v을 출력 하기 떄문에 전체 전압이 20v로 표시된다. delta = cursor2-cursor1 = 10-(-10)= 20.1이다.

  리포트 | 6페이지 | 2,000원 | 등록일 2019.07.29 | 수정일 2019.08.10

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  서울시립대학교 통신공학실습 5주차 예비레포트

  R=2K L=1M C=1U Q=0.0158 Q의 값이 낮은 경우에는 대역이 넓어져 바로 옆의 파형을 상쇄하기 때문에 파형 내부의 메시지부근이 삭제 된 것을 확인이 가능하다. ... 실제 PSPICE에서 구동한 결과 R=2K L=1M C=1U Q=0.0158 Q의 값이 낮은 경우에는 대역이 넓어져 바로 옆의 파형을 상쇄하기 때문에 파형 내부의 메시지부근이 삭제 ... 아래의 도표는 Q에 따른 Q값을 계산을 하였다 이론상으로 R=2K, L=1m C=1u일 경우 Q=0.0158의 값이 가장 작기 때문에 대역이 넓은 BPF를 설계가 가능하고 반대로 가장아래의

  리포트 | 7페이지 | 2,000원 | 등록일 2019.07.29 | 수정일 2019.08.10

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  서울시립대학교 통신공학실습 5주차 결과레포트

  추가로 통신에서는 데이터를 송신할 때 변조를 하는데 그 변조가 이루어지기 전에 데이터가 갖고 있는 주파수를 의미하기도 한다. ... Reference (참고문헌) 1) Hyperlink "https://www.rad ... 기본 세팅은 L=20m C=1n R=300 fm=200 Fc=35.588khz로 설정을 하였다.

  리포트 | 8페이지 | 2,000원 | 등록일 2019.07.29 | 수정일 2019.08.10

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